自从VHDL在1987年成为IEEE标准之后,就因其在电路模型建立、仿真、综合等方面的强大功能而被广泛用于复杂数字逻辑电路的设计中。佩德罗尼编著的《VHDL数字电路设计教程》共分为三个基本组成部分,首先详细介绍VHDL语言的背景知识、基本语法结构和VHDL代码的编写方法;然后介绍VHDL电路单元库的结构和使用方法,以及如何将新的设计加入到现有的或自己新建立的单元库中,以便于进行代码的分割、共享和重用;最后介绍CPLD和FPGA的发展历史、主流厂商提供的开发环境使用方法。本书在结构组织上有独特之处,例如将并发描述语句、顺序描述语句、数据类型与运算操作符和属性等独立成章,使读者更容易清晰准确地掌握这些重要内容。本书注重设计实践,给出了大量完整设计实例的电路图、相关基本概念、电路工作原理以及仿真结果,从而将VHDL语法学习和如何采用它进行电路设计有机地结合在一起。
《VHDL数字电路设计教程》适合通信工程、电子工程及相关专业的高年级本科生作为教材使用,同时也可以作为可编程逻辑器件应用开发的培训教材。
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